臺灣博碩士論文加值系統

摘要

本論文我們設計一個以鎖相迴路做為基礎的頻率合成器。鎖相迴路為廣泛應用於電子與通訊電路中之重要元件，它的用途為解決積體電路在高速及高整合度環境下的時脈誤差及頻率合成的問題。頻率合成器的應用廣泛，例如：電視機的選台器、無線網路卡等只要關乎頻率的鎖定都有它的存在，論文中的目的在於介紹頻率合成器的理論分析和實際設計一個頻率合成器的設計過程。
我們以台灣積體電路TSMC0.35um 2P4M製程來實現此頻率合成器，在工作電壓為3.3V，整個頻率合成器銷耗功率為40mW。本壓控振盪器振盪的頻率輸出範圍可從2.14GHz至2.75GHz，以防止當製程環境變動影響時，壓控振盪器無法合成預期高頻信號輸出；經觀察模擬結果，頻率合成器在各種不同邊緣模型(Corner Model)環境變動下仍可穩定輸出，當偏移頻率1MHz時，所量測之相位雜訊為-104dBc/Hz。

ABSTRACT
In this thesis we design a frequency synthesizer based on phase-locked- loop. The PLLs are important components widely used in the electronic and communication circuits. They are used to solve the clock skew and frequency synthesis problems of ICs in a fast operation speed and highly integrated environment. The application of the frequency synthesizer is extensive, for example: Television select platform device, so long as wireless network card ,etc. concern locking of frequency have existence of it, the purpose of this thesis lies in recommending the theory of the frequency synthesizer to analysis and the actual design process of a frequency synthesizer.
The TSMC 0.35 um BiCMOS Mixed Signal SiGe 2P4M process is used to implement the frequency synthesizer； its consumption power of the frequency synthesizer is 40mW with the 3.3V power supply. A wide range of ring VCO operation frequency, 1.1GHz-2.8GHz, is designed to ensure that the VCO still can generate the desired frequency even when the process conditions vary. Simulation results demonstrate that the synthesizer obtains a steady output signal under dierent corner models. The phase noise is obtained to be -106dBc/Hz.

目錄
摘要 I
第一章 序論 1
1.1 研究背景與動機 1
1.2 IEEE 802.11 WLAN 規範簡介 2
1.3 論文架構 3
第二章 鎖相迴路 4
2.1 簡易式與充電泵式鎖相迴路之比較 4
2.2 頻率合成器的大類 9
2.3 鎖相式頻率合成器的基本介紹 12
2.3.1 相位頻率偵測器 12
2.3.2 充電泵與迴路濾波器 13
2.3.3 電壓控制震盪器 17
2.3.4 除頻器 18
2.4 三階鎖相式的整數型頻率合成器數學分析 18
第三章 鎖相式頻率合成器 27
3.1 相位頻率偵測器的原理與類型 28
3.1.1 動態相位頻率偵測器的電路設計 32
3.1.2 相位頻率偵測器對閉迴路的影響 37
3.2 充電泵的電路分析 38
3.2.1 電路的非理想特性 38
3.2.2 充電泵的電路設計 41
3.2.3 充電泵的設計考量 44
3.3 二階迴路濾波器的設計 45
3.3.1 迴路濾波器對系統的影響 46
3.4 可程式化雙模除頻器的電路設計 47
3.5 壓控振盪器原理與類型 49
3.5.1 環型震盪器的電路設計 53
3.5.2 電壓控制振盪器對閉迴路的影響 59
3.6 雜訊分析 60
3.6.1 相位雜訊(phase noise) 60
3.6.2 抖動(jitter) 61
第四章 2.4GHz鎖相式頻率合成器之模擬驗證 64
4.1 電路架構模擬與比較 64
4.1.1 PFD模擬結果 64
4.1.2 充電泵 69
4.1.3 相頻偵測器、充電泵及濾波器的結果模擬 70
4.1.4 可程式化雙模除頻器結果模擬 72
4.1.5振盪器與雜訊分析模擬結果 74
4.1.5 鎖定結果模擬 82
4.2 電路佈局 87
第五章 結論 89
附錄 93
附錄A: 教育性晶片測試成果報告 93
附錄B: 教育性晶片測試成果報告 99

摘要 I
第一章 序論 1
1.1 研究背景與動機 1
1.2 IEEE 802.11 WLAN 規範簡介 1
1.3 論文架構 1
第二章 鎖相迴路 1
2.1 簡易式與充電泵式鎖相迴路之比較 1
2.2 頻率合成器的大類 1
2.3 鎖相式頻率合成器的基本介紹 1
2.3.1 相位頻率偵測器 1
2.3.2 充電泵與迴路濾波器 1
2.3.3 電壓控制震盪器 1
2.3.4 除頻器 1
2.4 三階鎖相式的整數型頻率合成器數學分析 1
第三章 鎖相式頻率合成器 1
3.1 相位頻率偵測器的原理與類型 1
3.1.1 動態相位頻率偵測器的電路設計 1
3.1.2 相位頻率偵測器對閉迴路的影響 1
3.2 充電泵的電路分析 1
3.2.1 電路的非理想特性 1
3.2.2 充電泵的電路設計 1
3.2.3 充電泵的設計考量 1
3.3 二階迴路濾波器的設計 1
3.3.1 迴路濾波器對系統的影響 1
3.4 可程式化雙模除頻器的電路設計 1
3.5 壓控振盪器原理與類型 1
3.5.1 環型震盪器的電路設計 1
3.5.2 電壓控制振盪器對閉迴路的影響 1
3.6 雜訊分析 1
3.6.1 相位雜訊(phase noise) 1
3.6.2 抖動(jitter) 1
第四章 2.4GHz鎖相式頻率合成器之模擬驗證 1
4.1 電路架構模擬與比較 1
4.1.1 PFD模擬結果 1
4.1.2 充電泵 1
4.1.3 相頻偵測器、充電泵及濾波器的結果模擬 1
4.1.4 可程式化雙模除頻器結果模擬 1
4.1.5振盪器與雜訊分析模擬結果 1
4.1.5 鎖定結果模擬 1
4.2 電路佈局 1
第五章 結論 1
附錄 1
附錄A: 教育性晶片測試成果報告 1
附錄B: 教育性晶片測試成果報告 1
表目錄
<表1. > γ與相位邊限PM …………………………………………..21
<表4.1> 相位頻率偵測器與模擬特性………………………………..72
<表4.2> 本論文與其他論文的特性比較………………………………..87
<表4.3> MPTPFD規格列表……………………………………………...88
<表4.4> DIVIDER規格列表……………………………………………..88

參考文獻

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